MR2A16AVMA35R【PDF 3/20 页】IC MRAM 4MBIT 35NS 48BGA

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MR2A16A

TABLE OF CONTENTS (CONT’D)

Figure 8 – Write Cycle Timing 1 ( W Controlled) ...............................................................................................12

Table 10 – Write Cycle Timing 2 ( E Controlled) ................................................................................................13

Figure 9 – Write Cycle Timing 2 ( E Controlled) .................................................................................................13

Table 11 – Write Cycle Timing 3 ( LB / UB Controlled) ....................................................................................14

Figure 10 – Write Cycle Timing 3 ( LB / UB Controlled) ..................................................................................14

ORDERING INFORMATION ............................................................................................................... 15

Table 12 – Ordering Part Number System for Parallel I/O MRAM..............................................................15

Table 13 – MR2A16A Ordering Part Numbers ..................................................................................................16

PACKAGE OUTLINE DRAWINGS ....................................................................................................... 17

Figure 11 – 44-TSOP2 Package Outline...............................................................................................................17

Figure 12 – 48-FBGA Packge Outline ...................................................................................................................18

REVISION HISTORY ........................................................................................................................... 19

HOW TO CONTACT US ....................................................................................................................... 20

Copyright ? Everspin Technologies 2013

3

MR2A16A Rev. 11, 10/2013

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